 Design LogiCORE PCI System |
| 入.學(xué).要.求 |
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學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識：
◆ 電路系統(tǒng)的基本概念。 |
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班.級.規(guī).模.及.環(huán).境 |
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為了保證培訓(xùn)效果，增加互動環(huán)節(jié)，我們堅持小班授課，每期報名人數(shù)限5人，多余人員安排到下一期進行。 |
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上課時間和地點 |
上課地點：【上�！浚和瑵髮W(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：深圳大學(xué)成教院/ 電影大廈(地鐵一號線大劇院站)【北京分部】：福鑫大樓/北京中山學(xué)院 【武漢分部】：佳源大廈（高新二路） 【南京分部】：金港大廈(和燕路)
【成都分部】：領(lǐng)館區(qū)1號（中和大道）
最近開課時間(連續(xù)班/周末班/晚班）：Design LogiCORE PCI System：2025年12月15日..以質(zhì)量贏得尊重節(jié)假日班火熱報名中.....實戰(zhàn)培訓(xùn)......直播、現(xiàn)場培訓(xùn)皆可....用心服務(wù)..............--即將開課----即將開課，請咨詢客服。 |
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學(xué)時 |
◆課時： 共6天,36學(xué)時
◆外地學(xué)員：代理安排食宿（需提前預(yù)定）
☆合格學(xué)員免費頒發(fā)相關(guān)資格證書，提升您的職業(yè)資質(zhì)
作為最早專注于嵌入式培訓(xùn)的專業(yè)機構(gòu)，曙海嵌入式學(xué)院提供的證書得到本行業(yè)的廣泛認
可，學(xué)員的能力得到大家的認同。
☆合格學(xué)員免費推薦工作
★實驗設(shè)備請點擊這兒查看★ |
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.最.新.優(yōu).惠. |
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◆團體報名優(yōu)惠措施：兩人95折優(yōu)惠，三人或三人以上9折優(yōu)惠 。注意：在讀學(xué)生憑學(xué)生證，即使一個人也優(yōu)惠500元。 |
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.質(zhì).量.保.障. |
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1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓(xùn)班中重聽；
2、培訓(xùn)結(jié)束后,培訓(xùn)老師留給學(xué)員手機和Email,免費提供半年的技術(shù)支持，充分保證培訓(xùn)后出效果；
3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。 ☆合格學(xué)員免費頒發(fā)相關(guān)工程師等資格證書，提升您的職業(yè)資質(zhì)。專注高端培訓(xùn)13年，曙海提供的證書得到本行業(yè)的廣泛認可，學(xué)員的能力得到大家的認同，受到用人單位的廣泛贊譽。 |
Design LogiCORE PCI System
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 課程介紹 |
高級嵌入式系統(tǒng)開發(fā)介紹了在嵌入式開發(fā)套件(EDK)設(shè)計環(huán)境中利用硬（嵌入式IBMPowerPC™)或軟(MicroBlaze™)處理器內(nèi)核進行嵌入式系統(tǒng)軟硬件開發(fā)，主題集中在高級IP 集成，操作系統(tǒng)移植，高級軟件調(diào)試技巧，系統(tǒng)引導(dǎo)方式及多種性能提升技巧。該課程包括提供嵌入式系統(tǒng)的開發(fā)、調(diào)試和仿真經(jīng)驗的動手實驗。 |
| 必備條件 |
?? 至少具備 6 個月的使用Xilinx 工具和FPGA 的設(shè)計經(jīng)驗
?? 基本了解 C 語言編程
?? 基本微處理器經(jīng)驗，了解 PowerPC 和MicroBlaze 系統(tǒng) |
| 課程概要 |
?? 理解和使用針對嵌入式設(shè)計的 Xilinx Platform Studio 工具的高級特性和技術(shù)
?? 構(gòu)建完整的嵌入式系統(tǒng)，包括硬件系統(tǒng)，軟件操作系統(tǒng)及相應(yīng) BSP
?? 構(gòu)建一個基于 Flash 嵌入式系統(tǒng)，并從外部存儲器中引導(dǎo)軟件系統(tǒng)
?? 嵌入式系統(tǒng)開發(fā)中如何采用多種調(diào)試手段，定位各類軟件問題及硬件問題
?? 如何提升硬件性能及軟件效率 |
| 實驗介紹 |
實驗1． 全面的系統(tǒng)開發(fā)
開發(fā)結(jié)合了 IP 核的硬件，以實現(xiàn)同按鈕、開關(guān)、LED、LCD 顯示和串行通信的接口開發(fā)與開關(guān)、按
鈕、LCD 顯示和串行通信互相作用的應(yīng)用程序。
實驗2． 外部存儲器和文件系統(tǒng)
設(shè)計包含 OPB (片上外圍總線) EMC/SDRAM IP 核的系統(tǒng)。在外部存儲器上開發(fā)執(zhí)行文件任務(wù)的應(yīng)用
程序。
實驗3． 使用ChipScope™ Pro 進行調(diào)試
利用ChipScope™ Pro 工具、GDB 和XMD 對堆棧錯誤同時進行硬軟件調(diào)試.
實驗4． 性能調(diào)整
描繪了在處理器上運行的一段簡單代碼，通過在硬件上對重復(fù)的功能進行緩存和移植，來反復(fù)調(diào)試和
精簡，從而提升性能。
實驗5． BFM 仿真
創(chuàng)建 EDK 系統(tǒng)，包含IBM CoreConnect 總線架構(gòu)總線模型(BFM)和用于OPBIP 的總線功能模型。仿
真基于OPB 總線的設(shè)計來驗證IP 功能。
實驗6． 系統(tǒng)引導(dǎo)
由于應(yīng)用程序大小和資源限制，所以需在Flash 中存儲、通過boot loader 程序引導(dǎo)至外部SRAM 中執(zhí)
行。 |
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