 Cadence模擬電路前端設計培訓 |
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班.級.規.模.及.環.境 |
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為了保證培訓效果，增加互動環節，我們堅持小班授課，每期報名人數限5人，多余人員安排到下一期進行。 |
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上課時間和地點 |
上課地點：【上�！浚和瑵髮W(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：深圳大學成教院/ 電影大廈(地鐵一號線大劇院站)【北京分部】：福鑫大樓/北京中山學院 【武漢分部】：佳源大廈（高新二路） 【南京分部】：金港大廈(和燕路)
【成都分部】：領館區1號（中和大道）
最近開課時間(連續班/周末班/晚班）：Cadence模擬電路前端設計培訓：2025年12月15日..以質量贏得尊重節假日班火熱報名中.....實戰培訓......直播、現場培訓皆可....用心服務..............--即將開課----即將開課，請咨詢客服。 |
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學時 |
◆課時： 共6天,36學時
◆外地學員：代理安排食宿（需提前預定）
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1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
2、培訓結束后,培訓老師留給學員手機和Email,免費提供半年的技術支持，充分保證培訓后出效果；
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Cadence模擬電路前端設計培訓
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培訓方式以講課和實驗穿插進行
課.程.描.述 ：
課程名稱: Virtuoso Analog Design?
Envirnment –v5141 |
課時長度: 4天 |
教師名稱:?付強 |
課程類型: |
模擬電路前端設計環境 |
課程簡述: |
通過參加ADE的培訓課程，你將會學習到如何在Cadence的Virtuoso環的設計輸入和驗證，其中包括原理圖的輸入，電路的仿真，并且學習如何用Cadence的?ADE環境。
通過在ADE?環境中進行一系列的仿真，你將會學習如何在每一個不同的的電路功能，去優化器件參數，并且可以預測其良率。帶有寄生的后仿真該課程之中。 |
應用軟件: |
IC51.4.1 |
課程內容和時間安排: |
第一階段 |
*??介紹和設計流程回顧?
*??頂層的行為級VerilogA模型仿真?
*??BiCMOS運算放大器的電路原理圖輸入?
*??設置模擬設計環境
*??使用Spectre跑電路仿真
*??分析仿真結果
*??學習使用波形顯示器的功能
*??使用Cadence新的波形顯示器WaveScan
*??保存和重新載入仿真狀態
*??在原理圖中標注仿真結果 |
第二階段 |
*??使用波形計算器測量仿真結果?
*??備份仿真數據?
*??使用條件搜索工具
*??體驗Spectre的掃描功能
*??使用OCEAN?和?SKILL
*??分析直流失配和瞬態操作點的結果
*??CDF |
第三階段 |
*??使用子電路和宏模型進行仿真?
*??使用inline的子電路?
*??設置和運行參數化分析
*??使用角模型分析工具
*??進行Monte Carlo分析 |
第四階段 |
*??使用層次化編輯器
*??設置寄生參數提取環境
*??在原理圖中反標寄生參數
*??帶有寄生的后仿真 |
適用對象: |
模擬和混合信號設計中，致力于電路設計和仿真的工程師?傾向于畢業后從事模擬和混合信號設計的學生
CAD?工程師 |
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